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超大规模集成电路中低功耗设计与分析

随着IC设计的规模更大,速度更快,以及便携式设备的广泛需求,设计中功耗的问题越来越凸现出来,所以在整个设计流程中就需要对功耗进行分析和低功耗设计,这些技术可以保证芯片的每一部分都能高效、可靠、正确地工作。 选择合适的低功耗手段,必须以细致的功耗预估为前提,并且也要掌握工具的适用范围和能到达的低功耗底限。在流程中尽可能早的分析出功耗需求,可以避免和功耗相关的设计失败。通过早期的分析,可以使用高层次的技巧来降低大批的功耗,更容易到达功耗的要求。 本论文围绕数字CMOS电路的功耗问题进行展开,主要分成两大部分。

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